ddr、DDR一致性測試，信號完整系測試，

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以通用計算機主板上的DDR2總線為例，DDR2信號線可以分為數據、命令、時鐘3部分。其中數據線部分主要完成數據傳輸工作，包括數據線DQ0-63、Data Mask線DM0-7、數據同步線DQS/DQS# (數據同步線可選單端或差分，通過設定內存芯片內部寄存器EMR[1]的A10位進行選擇)；命令線部分包括地址線A0-14、Bank選擇線BS0-2、行地址選擇RAS#、列選擇CAS#、寫使能WE#、片選CS#、時鐘使能CKE及芯片內部終端電阻使能ODT組成，主要完成尋址、組成各種控制命令及內存初始化工作；差分時鐘信號線CK/CK#為整個內存芯片工作提供時鐘。