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        電源完整性測試,電源輸出穩(wěn)定測試

        單價: 面議
        發(fā)貨期限: 自買家付款之日起 天內(nèi)發(fā)貨
        所在地: 直轄市 北京
        有效期至: 長期有效
        發(fā)布時間: 2023-12-18 03:26
        最后更新: 2023-12-18 03:26
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        詳細說明
        SI/PI是涉及數(shù)字電路正確操作的相關(guān)的兩種分析。SI重點確保傳輸?shù)?在接收器端還是1(對0同樣如此),對SI分析目標是消除關(guān)于信號質(zhì)量、串擾和定時的問題;

        信號質(zhì)量

        獲取具有明確的邊緣,且沒有過度過沖和下沖的信號。通常可以通過添加某種類型的端接以使驅(qū)動器的阻抗和傳輸線的阻抗相匹配來解決這些問題。對于多點分支總線,需要將端接和拓撲的長度變化相結(jié)合來控制反射。

        串擾

        涉及多條相互耦合的傳輸線,隨著走線擠進密集的電路板設(shè)計,了解它們正在相互耦合多少能量對于消除因串擾產(chǎn)生的錯誤是非常重要的。

        分析模型包括驅(qū)動器和接收器、芯片封裝及電路板互連(由走線及過孔、分立器件和/或連接器組成的模型)。

        驅(qū)動器和接收器模型

        包括緩沖器阻抗、翻轉(zhuǎn)率和電壓擺幅信息,通常IBIS或SPICE模型用作緩沖器模型

        互連模型

        包括行為類似與傳輸線的電路板走線。此類傳輸線具有阻抗、延遲和損耗特性,決定了所連接的驅(qū)動器和接收器與彼此進行交互的方式。

        基本的信號完整性分析包括設(shè)置電路板疊層(包括適當?shù)慕殡妼雍穸龋约安檎艺_的走線寬度,實現(xiàn)一定的走線目標阻抗。

         

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